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Detailed Description
3. Configuration Ports
The configuration port header (J17) supports all Virtex-5 device configuration modes. For
use with a Parallel Cable III or Parallel Cable IV cable, the header supports Slave Serial and
JTAG configuration modes.
Table 2 shows Serial mode connectivity between the configuration port header and a
Parallel Cable III or Parallel Cable IV flying-wire cable.
Table 2:
Serial Mode
Configuration Port Header
VCC3
GND
CCLK
DONE
DIN
PROG
Parallel Cable III/IV Pins
VCC
GND
CCLK
D/P
DIN
PROG
INIT
Table 3 shows JTAG mode connectivity between the configuration port header and a
Parallel Cable III or Parallel Cable IV flying-wire cable.
Table 3:
JTAG Mode
Configuration Port Header
VCC3V3
GND
TMS
TDI
TDO
TCK
INIT
Parallel Cable III Pins
VCC
GND
TMS
TDI
TDO
TCK
Parallel Cable IV Pins
VCC
GND
TMS
TDI
TDO
TCK
INIT
PC4 JTAG Configuration Interface
The JTAG configuration port (J1) for the board allows for device programming and FPGA
debug. This interface can be used with a Parallel Cable III or Parallel Cable IV cable for
JTAG programming and debugging via the JTAG configuration port.
12
www.xilinx.com
Virtex-5 LX FPGA Prototype Platform
UG222 (v1.1.1) March 21, 2011
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